基于电路划分与重新整合的量子张量表示

论文信息

标题: Quantum Tensor Representation via Circuit Partitioning and Reintegration

作者: Ziqing Guo, Jan Balewski, Kewen Xiao, et al.

发布日期: 2025-11-07

arXiv ID: 2511.05492v1

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研究问题：如何在保持可接受错误率的前提下，有效地将大规模量子电路拆分为可在含噪中等规模量子（NISQ）处理器上运行的子电路，并解决非全连接硬件拓扑与密集受控酉门切割之间的矛盾。
核心方法：提出 shardQ 框架，结合 SparseCut 电路切割算法、矩阵乘积态（MPS）编译器和全局编织（knitting）技术，实现最优的计算时间-错误率折衷。
关键结果：通过理论证明给出了计算时间与错误率之间的最优权衡关系（见论文第 4.2 节），并在 IBM Marrakesh 超导量子处理器上以消融实验验证了方法的有效性。
主要局限：论文未讨论方法在更深层电路或更多量子比特方向上的扩展性限制；MPS 编译对特定量子电路结构的适用性边界需进一步界定。
适合读者：从事量子电路编译、量子-经典混合算法设计、NISQ 时代的量子计算资源优化的研究人员和量子软件工程师。

论文背景和研究动机

量子计算通过叠加和纠缠有望在特定问题上超越经典算法，但当前的量子处理器（QPU）普遍受噪声和有限连通性制约。电路切割（circuit cutting）和编织（knitting）技术作为一种分治策略，将完整量子电路拆分为多个子电路，分别在量子硬件上执行，再通过经典后处理重组结果，从而缓解单次运行规模受限和误差累积的问题。

现有电路分割与重组方法大多关注用概率性的局部门替代通用非局部门，并度量经典通信复杂度。然而，两个核心痛点仍未得到充分解决：一是密集的受控酉门（如多比特 Toffoli 类门或任意控制旋转门）如何高效切割，这类门的切割如果简单展开会导致子电路数目激增；二是物理硬件的非全连接拓扑会极大增加远程门切割的经典通信开销。设计一种既能适应算法需求，又能贴合真实硬件拓扑的协议，是推动电路切割技术走向应用的关键。

在此背景下，shardQ 方法应运而生。它希望在切割紧凑受控酉门的同时，利用矩阵乘积态（MPS）编译将子电路转化为更易在目标拓扑上实现的形式，并借助全局编织技术融合切割与 MPS 的中间表示，直观地找出计算时间和错误率之间的最优平衡点。

核心方法和技术细节

shardQ 的核心在于三个组件的紧密协同：SparseCut 电路切割算法、MPS 编译，以及全局编织技术。

SparseCut 切割算法 SparseCut 针对由密集受控酉门构成的电路块进行切割。这类门通常有多个控制比特和一个目标比特，直接切割会在连接处产生大量虚拟量子比特通道。SparseCut 通过识别受控酉门的稀疏作用模式，将切割操作限制在与酉矩阵非平凡作用相关的子空间内，从而显著降低切割后的子电路数量和经典后处理的采样复杂度。算法输出一个由子电路和测量/重置操作组成的集合，每个子电路可以在硬件上独立执行。

矩阵乘积态编译 切割后每个子电路仍然可能包含远程 CNOT 门或不满足物理拓扑约束的交互。shardQ 将这些子电路映射为矩阵乘积态（MPS）表示，利用 MPS 的张量网络结构对量子门进行重新排列和局域化。在 MPS 空间中，长程受控门可以被近似为一系列局域张量收缩操作，并最终编译成符合硬件拓扑的本地门序列。这种编译方式可以灵活控制近似精度（bond dimension），从而调整门保真度与电路深度之间的折衷。

全局编织技术 不同于一般电路编织方法在切割边界处独立进行概率性门替换，shardQ 的全局编织技术将 SparseCut 产生的切割面与 MPS 编译的局部近似视为一个联合优化问题。它通过整体考虑所有子电路的概率分布、MPS 截断误差以及硬件噪声模型，构建一个经典的全局代价函数。求解该函数，可以从理论上给出计算时间（正比于子电路采样总数）和总输出误差率的最优权衡曲线。论文明确提供了该最优权衡的理论证明（见论文第 4.2 节），揭示在给定硬件模型下，如何选择切割粒度和 MPS 压缩比才能最小化综合开销。

方法整体流程可以概括为：输入电路 → SparseCut 切割为子电路 → 各子电路经 MPS 编译适配硬件拓扑 → 全局编织确定优化的子电路执行次数与后处理参数 → 在 QPU 上并行执行并经典重组。

创新点和贡献

紧凑受控酉门的直接切割：与传统需要将多控制门分解为单双比特门再切割的方法不同，SparseCut 直接在门的高维空间上识别切割面，避免了冗余子电路的生成。这在理论上缩减了经典后处理的通信量。
切割与张量网络编译的深度融合：将 MPS 编译嵌入整个切割-编织流水线，使得切割后的子电路可以优雅地适配任意拓扑的硬件，而不局限于原电路的连接模式。
最优权衡的理论保证：首次为电路切割与张量网络近似相结合的方法提供了计算时间-错误率的最优权衡证明（见论文第 4.2 节），这为实际部署时选择超参数提供了坚实的理论基础。
真实硬件上的消融验证：在 IBM Marrakesh 超导处理器上进行的实验，逐步移除 MPS 编译或全局编织模块，对比最终误差，证实了每个组件的正向贡献，并展示了方法的当前应用就绪水平。

实验结果分析

论文设计了在 IBM Marrakesh 超导 QPU 上的消融实验。实验选取了包含密集受控酉门的基准电路，分别测试完整 shardQ 流水线、仅 SparseCut + 传统切割编织（无 MPS 编译）、以及仅 MPS 编译直接执行（无切割）的三种配置。评估指标为输出与理想结果的保真度和总计算时间（包含量子执行和经典后处理）。

结果显示，完整 shardQ 配置在总计算时间仅小幅增加的情况下（因部分资源用于 MPS 编译的优化搜索），取得了显著低于另外两种配置的错误率。移除 MPS 编译后，非全连接拓扑导致的额外 SWAP 门插入使电路深度暴增，噪声累积明显；仅使用 MPS 编译而不切割，则受限于 MPS 近似精度，在处理紧凑受控酉门时保真度不足。这些对比确认了切割和 MPS 编译的协同互补作用（见论文第 5 节消融分析部分）。

论文进一步绘制了根据理论模型预测的计算时间-错误率曲线，并与实验观测点进行对比，发现两者趋势高度一致（见图 5）。这验证了全局编织技术所提供的最优权衡理论在真实噪声环境中的可行性。

实践建议

对于希望将 shardQ 方法引入量子软件开发或 NISQ 硬件基准测试的团队，可从以下方面着手：

切割粒度的选择：应依据目标量子硬件的噪声特性，先利用全局编织理论计算预期误差曲线，再确定 SparseCut 的最优切割度。通常，单次切割产生的虚拟比特数不宜超过 3，以控制经典采样方差。
MPS 编译的超参数调优：键维度（bond dimension）的选取直接影响编译后的电路深度和门近似误差。建议采用交叉验证方式，在小规模电路上建立键维度与输出保真度的经验关系，然后外推至目标电路。
硬件拓扑适配：在 MPS 编译阶段，应输入真实的硬件耦合图作为约束，而非假设全连接。shardQ 的编译过程天然接纳拓扑信息，忽略此约束会削弱其对非全连接硬件的优势。
经典后处理加速：后期重组过程涉及大量概率样本的加权合并。可以结合张量网络收缩库（如 opt-einsum）和 GPU 加速，降低后处理成为瓶颈的风险，使总体计算时间更接近 QPU 执行时间。
渐进式部署：建议先在模拟器上用噪声模型验证全流水线，确认无误后再迁移至真实 QPU，以避免直接硬件执行时因超出配额或长时间排队导致环境参数漂移。

随着量子硬件规模和噪声水平逐步改善，shardQ 的切割-编织-编译一体化方案有望成为连接重要量子算法与近期量子设备的实用桥梁，值得量子软件工程师和算法设计者深入探索其在不同领域问题中的泛化能力。